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Título: Diseño de un amplificador de ganancia programable con reducción de offset para la recepción de señales neuronales
Asesor(es): Saldaña Pumarica, Julio César; Raygada Vargas, Erick
Campo OCDE: https://purl.org/pe-repo/ocde/ford#2.02.01
Fecha de publicación: 4-abr-2019
Institución: Pontificia Universidad Católica del Perú
Resumen: En el presente trabajo de tesis se diseña un amplificador de ganancia programable con reducción de offset para ser usado en la recepción de señales neuronales. Estas señales tienen valores de frecuencia y amplitud específicas y relevantes para el presente diseño, con una amplitud de 10uV a 1mV para una frecuencia de 1-10KHz. Con estas consideraciones, el diseño del circuito se basó en una topología Two-stage fully differential Miller-Compensated amplifier. Se emplea la tecnología AMS 0.35um en el software Virtuoso de CADENCE utilizando el simulador Spectre y el entorno de simulación ADE XL para las simulaciones Montecarlo. Los resultados de las simulaciones se validaron en circuitos de testbench, siendo los más significativos, por ejemplo, una ganancia de lazo abierto de 81.1544 dB, ganancia de lazo cerrado de 75.1339 dB para un ancho de banda de 9.494KHz, un margen de fase de 68.8o y un margen de ganancia de 14.4dB, asegurando una estabilidad óptima del circuito. Así mismo, se obtuvo un rango de amplificación de 0-32 dB divididas en 8 ganancias controladas por interruptores basados en puertas de transmisión. Además, se realizó la distribución física del circuito empleando la vista LAYOUT XL de CADENCE. Los presentes resultados se obtuvieron con una alimentación de 3V y un voltaje de entrada en modo común de 1.5V.
Disciplina académico-profesional: Ingeniería Electrónica
Institución que otorga el grado o título: Pontificia Universidad Católica del Perú. Facultad de Ciencias e Ingeniería
Grado o título: Ingeniero Electrónico
Fecha de registro: 4-abr-2019; 4-abr-2019



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