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Mayor, D., (2021). Estudio del diseño de algoritmo de correspondencia a través de transformada Census mediante uso de FPGA [Pontificia Universidad Católica del Perú]. http://hdl.handle.net/20.500.12404/18820
Mayor, D., Estudio del diseño de algoritmo de correspondencia a través de transformada Census mediante uso de FPGA []. PE: Pontificia Universidad Católica del Perú; 2021. http://hdl.handle.net/20.500.12404/18820
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Title: Estudio del diseño de algoritmo de correspondencia a través de transformada Census mediante uso de FPGA
Authors(s): Mayor Vega, Dylan Hugo
Advisor(s): Flores Espinoza, Donato Andrés
OCDE field: http://purl.org/pe-repo/ocde/ford#2.02.01
Issue Date: 19-Apr-2021
Institution: Pontificia Universidad Católica del Perú
Abstract: La visión estereoscópica es la capacidad de adquirir dos imágenes en simultáneo cuando sus cámaras están separadas a una corta distancia; para que mediante algoritmos de procesamientos de imágenes se pueda determinar la correspondencia entre el pixel de la imagen original y su par estéreo. Existen diferentes algoritmos de correspondencia, siendo uno de ellos la transformada Census, la particularidad de este algoritmo es el uso de la operación lógica XOR, por lo que su desarrollo es a través de dicha compuerta digital; asimismo, la transformada Census permitirá obtener la distancia de Hamming y próximamente desarrollar la función costo de correspondencia para determinar los pixeles correspondientes dentro del par estéreo. Dicho algoritmo puede ser desarrollado en diferentes dispositivos electrónicos como la tarjeta de desarrollo FPGA, estas tarjetas cuentan con elementos adicionales al chip FPGA como una memoria externa SDRAM de 64 MB que puede ser usado para el almacenamiento de información y un procesador NIOS II para enviar la información de las imágenes estereoscópicas al módulo digital de transformada Census. En este trabajo se busca realizar el modelo de solución en base a la teoría del algoritmo de correspondencia en imágenes estereoscópicas a través de transformada Census y realizar un modelo de solución para su desarrollo en un FPGA.
Link to repository: http://hdl.handle.net/20.500.12404/18820
Discipline: Ciencias con mención en Ingeniería Electrónica
Grade or title grantor: Pontificia Universidad Católica del Perú. Facultad de Ciencias e Ingeniería
Grade or title: Bachiller en Ciencias con mención en Ingeniería Electrónica
Register date: 19-Apr-2021
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